开芯院发布“开芯云”RISC-V SoC敏捷设计云平台
2024年8月22日下午,北京开源芯片研究院研发总监赵华龙博士在 2024 RISC-V中国峰会主会现场,正式发布“开芯云”(OSChip) RISC-V SoC 敏捷设计云平台。
开芯院研发总监赵华龙发布
“开芯云” RISC-V SoC敏捷设计云平台
“开芯云”围绕设计、验证、软件、调试构建了芯片设计的核心工具链,涵盖RISC-V处理器IP生成工具、SoC芯片生成工具、UVM生成工具、波形调试工具、联合调试工具等,支持第三方工具集成,配备了用户管理、工程管理、IP管理、文档管理等一系列管理功能,目前已面向全球学术界、产业界开放评估试用。
OSChip 平台的架构组件
该平台集合了如下典型功能:
RISC-V处理器IP生成工具
(Core Generator)
“拖拽式”SoC 生成工具
(Soc Generator)
UVM生成工具
(UVM Generator)
波形调试工具 伯牙BoYa
SW co-sim Debugger 联合调试工具
另外,该平台还包括OS 自动porting,BSP/MCAL生成工具等。同时还支持第三方工具。
“开芯云”的推出将有望解决嵌入式芯片领域生态碎片化的问题,将有效降低企业开发门槛,提高人效比,加速产品的上市时间。在这个平台上,可以支持团队级的开发协同,可以采用我们或者任意第三方站点的版本仓库进行代码维护。通过平台,让用户可以在任何时间、任何地点,用任何设备在此平台上开展工作,它能够提供最大弹性的基础设施利用率,灵活应对每个企业或团队的开发波峰与波谷,从而优化成本并提高运营效率。
更多合作,欢迎联系开芯院对外合作主管郭老师
邮箱:guoqing@bosc.ac.cn
电话:18310238237
关于北京开源芯片研究院
2024-08-23 15:48